全パターンをEBで露光した0.2μm nMOSFETの試作
書誌事項
- タイトル別名
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- 0.2μm nMOSFET using EB lithography for all Mask Process
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抄録
全ての露光行程にEB露光を用いたnMOSFETを試作した。ゲート酸化膜厚は10nmである。このMOSFETはゲート長0.23μmのものまで良好な飽和特性が得られており、しきい値0.3Vのものでは電源電圧3Vで約0.52mA/μmのオン電流が得られた。また、ゲート長0.21μmのnMOSリングオシレータ-はゲート一段あたりの52psの遅延時間が得られた。
収録刊行物
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- 電子情報通信学会技術研究報告. SDM, シリコン材料・デバイス
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電子情報通信学会技術研究報告. SDM, シリコン材料・デバイス 98 (555), 13-18, 1999-01-22
一般社団法人電子情報通信学会
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詳細情報 詳細情報について
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- CRID
- 1574231877181735040
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- NII論文ID
- 110003310158
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- NII書誌ID
- AN10013254
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- 本文言語コード
- ja
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- データソース種別
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- CiNii Articles