マルチプロセッサRTOS対応コシミュレータ(システム設計/評価技術)  [in Japanese] A Cosimulator with Multiprocessor RTOS  [in Japanese]

    • 古川 貴士 Furukawa Takashi
    • 名古屋大学大学院情報科学研究科 Dept. of Information Engineering, Graduate School of Information Science, Nagoya Univ.
    • 柴田 誠也 Shibata Seiya
    • 名古屋大学大学院情報科学研究科 Dept. of Information Engineering, Graduate School of Information Science, Nagoya Univ.

    • 冨山 宏之 Tomiyama Hiroyuki
    • 名古屋大学大学院情報科学研究科 Dept. of Information Engineering, Graduate School of Information Science, Nagoya Univ.
    • 高田 広章 Takada Hiroaki
    • 名古屋大学大学院情報科学研究科 Dept. of Information Engineering, Graduate School of Information Science, Nagoya Univ.

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Abstract

本研究では,シングルプロセッサ用ISSを拡張し,マルチプロセッサRTOSに対応したコシミュレータを実現した.本コシミュレータでは,複数のISSとハードウェアシミュレータを同時に起動・接続し,各ISSが一つのプロセッサをシミュレーションすることで,マルチプロセッサシステムのコシミュレーションを行う.本コシミュレータを用いて,MPEGデコーダのコシミュレーション実験と,ISSの拡張によるオーバヘッドの測定を行った.

This paper presents a cosimulator with multiple ISSs where a multiprocessor embedded RTOS can be executed. The ISS was extended from an ISS for single processor embedded systems. In our cosimulator, multiple ISSs and hardware simulators can be executed concurrently with communication. Each of the ISSs simulates one processor. Using the cosimulator, we performed cosimulation of MPEG decoding system, and evaluated the overhead due to extension of the ISS.

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IPSJ SIG Notes   [List of Volumes]

IPSJ SIG Notes 2008(1), 17-22, 2008-01-15  [Table of Contents]

Information Processing Society of Japan (IPSJ)

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Codes

  • NII Article ID (NAID) :
    110006625505
  • NII NACSIS-CAT ID (NCID) :
    AN10096105
  • Text Lang :
    JPN
  • Article Type :
    ART
  • ISSN :
    09196072
  • NDL Article ID :
    9372703
  • NDL Source Classification :
    ZM13(科学技術--科学技術一般--データ処理・計算機)
  • NDL Call No. :
    Z14-1121
  • Databases :
    CJP  NDL  NII-ELS