SATソルバによるCMOS回路のレイアウト面積最小化手法
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- SAT ソルバ ニ ヨル CMOS カイロ ノ レイアウト メンセキ サイショウカ シュホウ
- Area Minimization Method for Layout of CMOS Circuits Using SAT-Solver
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収録刊行物
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- 回路とシステムワークショップ論文集 Workshop on Circuits and Systems
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回路とシステムワークショップ論文集 Workshop on Circuits and Systems 28 237-242, 2015-08
[東京] : [電子情報通信学会]