ルール型ファジィ情報処理システムのハードウェア化に関する研究 ルールガタ ファジィ ジョウホウ ショリ システム ノ ハード ウェア カ ニ カンスル ケンキュウ

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著者

    • 佐々木, 守 ササキ, マモル

書誌事項

タイトル

ルール型ファジィ情報処理システムのハードウェア化に関する研究

タイトル別名

ルールガタ ファジィ ジョウホウ ショリ システム ノ ハード ウェア カ ニ カンスル ケンキュウ

著者名

佐々木, 守

著者別名

ササキ, マモル

学位授与大学

熊本大学

取得学位

学術博士

学位授与番号

甲第21号

学位授与年月日

1991-03-26

注記・抄録

博士論文

目次

  1. 目次 / (0003.jp2)
  2. 第1章 序論 / p1 (0006.jp2)
  3. 第2章 多入力メンバーシップ関数の構成法 / p7 (0012.jp2)
  4. 2.1 多入力区分線形メンバーシップ関数の構成アルゴリズム / p8 (0013.jp2)
  5. 2.2 ステップ状に変化する区分線形メンバーシップ関数の構成アルゴリズム / p14 (0019.jp2)
  6. 2.3 補間多項式としての区分線形メンバーシップ関数 / p18 (0023.jp2)
  7. 2.4 構成例 / p20 (0025.jp2)
  8. 2.5 回路構成 / p25 (0030.jp2)
  9. 2.6 回路設計,回路解析 / p27 (0032.jp2)
  10. 2.7 回路設計例とそのSPICEシミュレーション / p48 (0053.jp2)
  11. 2.8 応用について / p49 (0054.jp2)
  12. 第3章 電流モードによる多入力max/min回路 / p57 (0062.jp2)
  13. 3.1 多入力max/min回路 / p58 (0063.jp2)
  14. 3.2 連立限界差方程式を用いたmax回路の解析 / p63 (0068.jp2)
  15. 3.3 チャネル長変調効果の影響 / p69 (0074.jp2)
  16. 3.4 SPICEシミュレーション / p76 (0081.jp2)
  17. 3.5 トランジスタ数について / p81 (0086.jp2)
  18. 第4章 電流モードによるアナログファジィコントローラの構成 / p83 (0088.jp2)
  19. 4.1 ファジィ制御アルゴリズム / p84 (0089.jp2)
  20. 4.2 回路構成 / p88 (0093.jp2)
  21. 4.3 SPICE2による回路シミュレーション / p100 (0105.jp2)
  22. 4.4 検討 / p103 (0108.jp2)
  23. 第5章 ファジィ推論専用ディジタル・プロセッサ / p106 (0111.jp2)
  24. 5.1 ファジィ推論の並列実行 / p107 (0112.jp2)
  25. 5.2 前件部(レベル1)プロセッサの構成 / p109 (0114.jp2)
  26. 5.3 後件部(レベル2)プロセッサ / p123 (0128.jp2)
  27. 5.4 チップ化とシステム構成,応用 / p138 (0143.jp2)
  28. 第6章 結論 / p141 (0146.jp2)
  29. 謝辞 / p144 (0149.jp2)
  30. 参考文献 / p145 (0150.jp2)
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各種コード

  • NII論文ID(NAID)
    500000076169
  • NII著者ID(NRID)
    • 8000000076372
  • DOI(NDL)
  • 本文言語コード
    • jpn
  • NDL書誌ID
    • 000000240483
  • データ提供元
    • 機関リポジトリ
    • NDL-OPAC
    • NDLデジタルコレクション
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