A study on design support for computer architecture design コンピュータ・アーキテクチャの設計支援に関する研究

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著者

    • 赤星, 博輝 アカボシ, ヒロキ

書誌事項

タイトル

A study on design support for computer architecture design

タイトル別名

コンピュータ・アーキテクチャの設計支援に関する研究

著者名

赤星, 博輝

著者別名

アカボシ, ヒロキ

学位授与大学

九州大学

取得学位

博士 (工学)

学位授与番号

甲第3802号

学位授与年月日

1996-03-27

注記・抄録

博士論文

目次

  1. Contents / p5 (0007.jp2)
  2. 1 Introduction / p1 (0011.jp2)
  3. 1.1 VLSI Technology and Microprocessors / p1 (0011.jp2)
  4. 1.2 Advancement of CAD Technology / p2 (0012.jp2)
  5. 1.3 Architecture Design / p3 (0013.jp2)
  6. 1.4 Outline of Our Research / p5 (0015.jp2)
  7. 1.5 Organization of the Thesis / p6 (0016.jp2)
  8. 2 Related Works / p11 (0021.jp2)
  9. 2.1 System Design / p11 (0021.jp2)
  10. 2.2 Co-processor Level Hardware/Software Codesign / p14 (0024.jp2)
  11. 2.3 Processor Level Hardware Software Codesign / p17 (0027.jp2)
  12. 2.4 Our Research / p19 (0029.jp2)
  13. 3 COACH / p21 (0031.jp2)
  14. 3.1 Traditional Design Methodology / p21 (0031.jp2)
  15. 3.2 Our Design Methodology / p22 (0032.jp2)
  16. 3.3 Required CAD Support&Problems / p24 (0034.jp2)
  17. 3.4 COACH Design System / p27 (0037.jp2)
  18. 3.5 Conclusion / p30 (0040.jp2)
  19. 4 Instruction Extraction / p33 (0043.jp2)
  20. 4.1 What is Instruction Extraction / p33 (0043.jp2)
  21. 4.2 Concept of Instruction Extraction / p34 (0044.jp2)
  22. 4.3 ARET / p39 (0049.jp2)
  23. 4.4 Input&Output / p40 (0050.jp2)
  24. 4.5 Instruction Extraction / p41 (0051.jp2)
  25. 4.6 Experiments / p52 (0062.jp2)
  26. 4.7 Conclusion / p57 (0067.jp2)
  27. 5 Fast Simulation Model Generation / p65 (0075.jp2)
  28. 5.1 What is Simulation Model Generation? / p65 (0075.jp2)
  29. 5.2 Definition of Instruction Level Simulation / p68 (0078.jp2)
  30. 5.3 Algorithm for Simulation Model Generation / p68 (0078.jp2)
  31. 5.4 Prototype of Fast Simulation Model Generator / p74 (0084.jp2)
  32. 5.5 Experiments / p76 (0086.jp2)
  33. 5.6 Conclusion / p83 (0093.jp2)
  34. 6 Compiler Generation / p85 (0095.jp2)
  35. 6.1 Compiler Generation / p86 (0096.jp2)
  36. 6.2 Compiler Generation / p92 (0102.jp2)
  37. 6.3 Prototype / p101 (0111.jp2)
  38. 6.4 Experiments / p104 (0114.jp2)
  39. 6.5 Conclusion / p110 (0120.jp2)
  40. 7 Conclusions and Future Work / p113 (0123.jp2)
  41. 7.1 Summary of Major Results / p113 (0123.jp2)
  42. 7.2 Future Work / p115 (0125.jp2)
  43. A UDL/I / p129 (0139.jp2)
  44. A.1 UDL/I Grammer of Instruction Extractor / p129 (0139.jp2)
  45. A.2 System Functions for Instruction Extractor / p140 (0150.jp2)
1アクセス

各種コード

  • NII論文ID(NAID)
    500000131562
  • NII著者ID(NRID)
    • 8000000966224
  • DOI(NDL)
  • NDL書誌ID
    • 000000295876
  • データ提供元
    • NDL-OPAC
    • NDLデジタルコレクション
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