SystemVerilog入門 : 設計・仕様・検証のためのハードウェア記述言語
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SystemVerilog入門 : 設計・仕様・検証のためのハードウェア記述言語
共立出版, 2020.10
- Other Title
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Introduction to SystemVerilog : hardware design, specification, and verification with SystemVerilog
SystemVerilog入門 : 設計仕様検証のためのハードウェア記述言語
- Title Transcription
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System Verilog ニュウモン : セッケイ・シヨウ・ケンショウ ノ タメ ノ ハードウェア キジュツ ゲンゴ
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Note
SystemVerilogの言語の持つ意味から実践で使用するための知識までを習得できる入門書。Verilogとの差異、設計および検証作業で必要となる基本的な機能を中心に解説する。
参考文献: p[415]-416
Description and Table of Contents
Table of Contents
- 概要
- 設計および検証のためのビルディングブロック
- データタイプ
- メンバーで構成されるデータタイプ
- クラス
- プロセス
- 代入文
- オペレータと式
- 実行文
- タスクとファンクション〔ほか〕
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