組み合わせ論理回路のソフトエラー評価を可能とするLSIテスト技術
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組み合わせ論理回路のソフトエラー評価を可能とするLSIテスト技術
(科学研究費補助金(基盤研究C)研究成果報告書, 平成18年度-平成19年度)
[小林大輔], 2008.3
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クミアワセ ロンリ カイロ ノ ソフトエラー ヒョウカ オ カノウトスル LSI テスト ギジュツ
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注記
課題番号18560359
研究分担者:廣瀬和之、斎藤宏文